崗位職責
1根據項目需求，制訂信號鏈SOC FPGA/DSP原型方案及架構；
2設計數模接口調理電路，優化高速信號 PCB 布線。用硬件 + 模型結合方式模擬模擬模塊特性。移植 算法代碼到 FPGA或DSP，執行功能驗證，測試數模交互邏輯；評估時序信號完整性等性能指標，定位并解決邏輯接口或時序問題；
3與算法數字模擬驗證工程師協作，保障設計流暢。編寫原型架構時序約束測試方案等文檔。根據設計迭代更新原型，支持流片后測試對比，輔助定位問題。
任職要求
2026屆應屆生，碩士或以上學歷，微電子電子信息工程等相關專業。
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1根據項目需求，制訂信號鏈SOC FPGA/DSP原型方案及架構；
2設計數模接口調理電路，優化高速信號 PCB 布線。用硬件 + 模型結合方式模擬模擬模塊特性。移植 算法代碼到 FPGA或DSP，執行功能驗證，測試數模交互邏輯；評估時序信號完整性等性能指標，定位并解決邏輯接口或時序問題；
3與算法數字模擬驗證工程師協作，保障設計流暢。編寫原型架構時序約束測試方案等文檔。根據設計迭代更新原型，支持流片后測試對比，輔助定位問題。
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- 公司性質：私營企業
- 所屬行業：IT行業-計算機、互聯網、通訊、電子、儀器儀表等
- 所在地區：廣東-深圳市
- 聯系人：徐玉玲
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- 郵政編碼：518055
工作地址
- 地址：深圳市南山區粵海街道
